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专注芯片设计的最后一公里

精准修改网表,
保持设计意图。

用 GOF 串联设计变更与 ECO 验证。在统一工作流中生成局部补丁、处理物理约束,并检查逻辑等价性。

当前版本 GOF 11.9更新说明

GOF 工作流
从设计意图到网表实现
网表补丁示意图 DFFDFFAND
网表补丁示意图
  1. 01
    设计变更RTL · 网表 · 约束
  2. 02
    局部 ECO分析 · 修复 · 映射
  3. 03
    验证结果逻辑等价性检查

让设计变更与补丁实现有迹可循。

功能 ECO仅金属层 ECO逻辑等价性AI 辅助调试

统一的 GOF 平台

精准应对每个阶段的设计变更。

围绕同一门级设计开展 ECO、验证和调试,从适合您当前流程的能力开始。

01

GOF ECO

通过 RTL 引导、脚本驱动及备用单元映射等流程,生成网表功能补丁。

02

GOF AI

将自然语言需求转化为 GOF 脚本,为 ECO 和调试引入 AI 辅助。

技术资料

深入了解方法与实践。

完整实例

从数小时到数分钟

查看基准案例、生成的补丁,以及跨设计阶段重放脚本的完整流程。

查看基准案例

GOF AI

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